Analistas independentes já observaram que os pedidos para a produção de chips para aceleradores da Nvidia neste ano exigirão o uso de 77% de todos os wafers de silício disponíveis da classe correspondente. Fontes taiwanesas acrescentam agora que esses mesmos pedidos utilizarão cerca de 70% da capacidade de teste e empacotamento de chips da empresa usando o método avançado CoWoS-L.
Fonte da imagem: NVIDIA
A tecnologia de empacotamento é necessária para produzir chips da geração Blackwell que alimentam os aceleradores de computação de ponta da Nvidia, relata o Economic Daily News. Ao longo deste ano, a TSMC aumentará sua capacidade de embalagem de chips em pelo menos 20% trimestralmente, o que lhe permitirá processar mais de 2 milhões de produtos desse tipo até o final do ano. Além disso, uma demanda adicional pode ser criada por pedidos de participantes da iniciativa Stargate nos Estados Unidos, já que o desenvolvimento da estrutura computacional nacional naquele país também exigirá um número razoável de aceleradores Nvidia.
Embora os serviços avançados de embalagem de chips tenham sido responsáveis por 8% da receita total da TSMC no ano passado, eles ultrapassarão 10% este ano, de acordo com a administração da empresa. A expansão da produção de aceleradores de geração Blackwell reduzirá gradualmente a necessidade de representantes da família Hopper (H100/H200), e a nova geração começará a dominar no segundo semestre do ano.
Há relatos de que a TSMC está se esforçando para expandir oito de suas instalações de encapsulamento de chips CoWoS em um futuro próximo. Entre elas estão duas empresas compradas da Innolux, que anteriormente produzia painéis de exposição. Além disso, a TSMC ainda não decidiu o local para a construção de duas novas usinas desse perfil. Como a gerência da TSMC nunca se cansa de observar, mesmo a taxa atual de expansão das capacidades de empacotamento de chips não permite cobrir a demanda existente por esses serviços. Do final do ano passado até o final do ano que vem, a TSMC planeja triplicar sua capacidade de embalagem de chips.
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