NVIDIA vendeu mais de 1 bilhão de núcleos RISC-V em um ano

Como parte da cúpula RISC-V 2024, a NVIDIA compartilhou estatísticas interessantes – ao longo do ano, ela enviou mais de 1 bilhão de núcleos RISC-V de seu próprio design como parte de GPUs e outros aceleradores, relata TechPowerUp. Eles fazem parte do GSP (GPU System Processor), responsável por gerenciar a GPU e outras funções de serviço. Um GSP tem de 10 a 40 núcleos, dependendo da complexidade do chip que ele controla.

A empresa passou a desenvolver um novo GSP baseado em RISC-V em 2016. Antes disso, por mais de dez anos, a NVIDIA usou um processador Falcon proprietário para GSP, cujas capacidades e flexibilidade se tornaram insuficientes com o tempo. Em vez de comprar e modificar núcleos prontos para uso de fornecedores terceirizados (Arm, MIPS, Synopsys ARC) ou tentar melhorar o Falcon, a empresa decidiu recorrer à arquitetura aberta RISC-V e até agora desenvolveu três tipos de núcleos.

Fonte da imagem: NVIDIA

Assim, o NV-RISCV32 é o núcleo de 32 bits mais simples sem execução fora de ordem, operando em frequência de até 1,8 GHz e tendo desempenho de até 1,8 CoreMark/MHz. NV-RVV é NV-RISCV32 com extensões vetoriais de 1024 bits. E o NV-RISCV64 é um núcleo mais sério de 64 bits com suporte para execução fora de ordem e SMP, frequência de 2 GHz e desempenho de 5 CoreMark/MHz. Além disso, a NVIDIA desenvolveu mais de 20 extensões ISA para tarefas específicas.

O GSP baseado em RISC-V apareceu pela primeira vez na geração Turing em 2018. Agora GSP é responsável pelo gerenciamento de energia e recursos do acelerador, segurança, comunicação entre chips, gerenciamento de codec de vídeo, saída de vídeo, trabalho com NVDLA, etc. O Google escolheu um caminho semelhante: seus aceleradores TPU AI usam núcleos SiFive. No entanto, agora já existem “grandes” aceleradores de IA construídos exclusivamente em núcleos RISC-V: Meta✴ MTIA de primeira e segunda gerações, InspireSemi Thunderbird, Tenstorrent Wormhole e Grayskull, bem como Esperanto ET-SoC-1 e ET-SoC – 2.

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